Design
Gatewayの低遅延ネットワークIPは、高頻度取引(HFT)や高速取引(HST)等の超低レイテンシーを要求するFintechアプリケーションに対応するために専用に設計されています。
またシステム固有の要件に合わせて、低レイテンシー・ネットワークIPコアとFPGAロジックのカスタマイズのトータル・ソリューションを提供致します。
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Accelerated Algorithmic Trading (AAT) アクセラレータ&システムは、トレーディング戦略を飛躍的に強化するための先進的なターンキー・ソリューションです。FPGAアクセラレーションと超低遅延IPコア技術を採用し、現代の金融市場が求める厳しい性能要件に対応します。ブローカー、取引所、マーケットデータベンダー、セルサイドベンダー、自己売買トレーダーに向けて、優れた競争力を提供します。 また、超低遅延IPコア(TOE、UDP、EMAC)デモと、HLS(C/C++)サンプルコードを活用したAccelerated Algorithmic
Trading (AAT)リファレンス・デザインは、Alveo X3552PVカードに加え、AMDの標準FPGAボード単体でもご利用いただけます。 |
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Accelerated Algorithmic Trading with ITCH/OUCH (AAT-ITCH/OUCH) デモは、10G Ethernet上で動作する高性能トレーディングシステムを実証する最新のリファレンス・デザインです。Alveo X3522PVカード上で、優れたコスト効率と超低レイテンシを実現します。 本デモには、ITCH/OUCH取引プロトコル向けに最適化されたAAT IP Suiteを搭載しており、FPGAハードウェア上での高頻度取引(HFT)アプリケーションに向けて、HLS(C/C++)ベースのトレーディングロジック実装をサポートしています。 詳しくはこちら (FinoLogic ページ) |
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![]() YouTube Video![]() DG LL 10G EMAC-IP + AAT QDMA デモ |
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![]() YouTube Video![]() DG LL UDP10GRx-IP 16 セッションデモ |
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![]() YouTube Video![]() DG TOE10GLL-IP 32 セッションデモ |
| 資料 | Update (Revision) |
| プレゼンテーション | 1.1J |
| ブロシュアー | Rev2026Q1JX |
| IP コア & オプション | データシート | リファレンス デザイン ドキュメント |
デモ手順書 | FPGA ボードセットアップ | 無償評価デモファイル | |
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| Accelerated Algorithmic Trading (
AAT
) QDMA デモ (LL10GEMAC + TOE10GLL + LLUDP10GRx) |
X3522 | |||||
| Accelerated Algorithmic Trading (
AAT
) デモ (LL10GEMAC + TOE10GLL + LLUDP10GRx) |
U50 U250 |
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| LL 10GEMAC-IP | ZCU102 | |||||
| Accelerated Algorithmic Trading ( AAT ) ITCH/OUCH Demo | X3522 |
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| Accelerated Algorithmic Trading ( AAT ) DYNANIC Calypte DMA Demo | X3522 | ![]() |
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| Accelerated Algorithmic Trading ( AAT ) QDMA デモ | X3522 U50 U55C U250 |
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| Accelerated Algorithmic Trading ( AAT ) デモ | U50 U250 |
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| LL UDP10GRx-IP | ZCU102 KCU116 |
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| 16 セッション デモ | ZCU102 KCU116 |
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| TOE10GLL-IP | X3522 ZCU102 ZCU106 |
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| 32 セッション デモ | ZCU102 ZCU106 |
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| Linux アプリケーション向け TCPオフロード (SocketXpress) |
KR260 | ![]() |
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